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基于HDTV系统的串行级联译码器设计与实现

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摘要

通过对串行级联码编译码原理的研究分析,结合串行级联码在通信系统中的纠错性能仿真,从硬件实现的角度,提出了串行级联编译码器的总体实现方案.最后基于FPGA电路实现了串行级联的译码,并通过了可编程器件的验证,同时给出了在Quartus环境下的仿真波形.

著录项

来源
《电视技术》 |2003年第4期|39-41|共3页
作者
郝东来; 蒋卓勤; 刘永祥;
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作者单位

西安通信学院电子技术教研室,陕西,西安,710106;

西安通信学院电子技术教研室,陕西,西安,710106;

西安通信学院电子技术教研室,陕西,西安,710106;

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正文语种 chi
中图分类通信;
关键词
HDTV; 串行级联码; RS码; Viterbi译码; FPGA;

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