Data path synthesis in digital electronics. I. Memory allocation

Chen C.H.

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Data path synthesis in digital electronics. I. Memory allocation

机译：数字电子学中的数据路径综合。一，内存分配

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A data path consists of memory elements (i.e., registers), data operators (i.e. ALUs) and interconnection units (i.e. buses) to control the data transfers in the digital system. Many approaches to hardware allocation for data path synthesis have been proposed in the literature; however, only single-port memory is considered for register allocation and no efficient synthesis approach for multiport memory synthesis. A novel design methodology for data path synthesis using multiport memories is proposed which can be applied to hardware allocation algorithms or to already synthesized data path as a postprocessor to achieve a better design. Illustrations of applying this method to different synthesis examples are presented. Results and improvements over previous techniques are demonstrated. Experiments on benchmarks show very promising results

机译：数据路径由存储元件（即寄存器），数据运算符（即ALU）和互连单元（即总线）组成，以控制数字系统中的数据传输。文献中已经提出了许多用于数据路径综合的硬件分配方法。但是，只考虑单端口存储器进行寄存器分配，而没有有效的综合方法进行多端口存储器综合。提出了一种使用多端口存储器进行数据路径合成的新颖设计方法，该方法可以应用于硬件分配算法或作为后处理器应用于已经合成的数据路径，以实现更好的设计。给出了将该方法应用于不同合成示例的说明。展示了对先前技术的结果和改进。基准测试显示非常令人鼓舞的结果

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来源
《IEEE Transactions on Aerospace and Electronic Systems》 |1996年第1期|p.2-15|共14页
作者
Chen C.H.;
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作者单位

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收录信息
原文格式 PDF
正文语种 eng
中图分类航空;
关键词
high level synthesis; logic CAD; multiport networks; storage allocation; data operators; data path synthesis; design methodology; digital electronics; hardware allocation; hardware allocation algorithms; interconnection units; memory allocation; memory elements; mult;

机译：高级综合;逻辑CAD;多端口网络;存储分配;数据运算符;数据路径综合;设计方法论;数字电子学;硬件分配;硬件分配算法;互连单元;内存分配;内存元素;mult;

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