Design and Analysis of On-Chip Router for Network On Chip

Ms. A.S. Kale; Prof. M.A.Gaikwad

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Design and Analysis of On-Chip Router for Network On Chip

机译：片上网络片上路由器的设计与分析

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—Continuous scaling of CMOS technology makes it possible to integrate a large number of heterogeneous devices that need to communicate efficiently on a single chip. For this efficient routers are needed to takes place communication between these devices. This paper gives the design of onchip routers based on optimizing power consumption and chip area. Proposed architecture of onchip router in this paper give the results in which power consumption is reduced and silicon area is also minimize.

机译：－ CMOS技术的连续扩展使得可以在单个芯片上集成大量需要有效通信的异构设备。为此，需要高效的路由器在这些设备之间进行通信。本文基于优化功耗和芯片面积给出了片上路由器的设计。本文中提出的片上路由器架构可以降低功耗并减小硅面积。

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《International Journal of Computer Trends and Technology》 |2011年第3期|共页
作者
Ms. A.S. Kale; Prof. M.A.Gaikwad;
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正文语种
中图分类计算技术、计算机技术;
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