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Fault tolerant systolic evaluation of polynomials and exponentialsof polynomials for equispaced arguments

机译：等距参数的多项式和多项式的指数的容错脉动评估

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Many applications in digital signal processing and computer graphics, which require high speed evaluation of polynomials and exponentials of polynomials can now be implemented in hardware very efficiently because of the advances in VLSI technology. Several fast algorithms have been proposed in the recent past for the efficient evaluation of polynomials and exponentials of polynomials for equispaced arguments on uniprocessor systems. In this brief, we consider the problem of organizing this evaluation on VLSI chips in the form of systolic arrays. We use triple time redundancy and algorithm-based fault tolerance to detect and correct errors caused by transient failures in the Processing Elements (PEs) of these systolic arrays. A comparison of the space and time overheads in using these two methods for adding fault tolerance is also discussed
机译：由于VLSI技术的进步，现在需要在硬件中非常高效地实现数字信号处理和计算机图形学中的许多应用，这些应用需要对多项式和多项式的指数进行高速评估。最近，已经提出了几种快速算法，用于有效评估单处理器系统上等距自变量的多项式和多项式的指数。在本摘要中，我们考虑了以脉动阵列的形式对VLSI芯片组织此评估的问题。我们使用三倍时间冗余和基于算法的容错能力来检测和纠正由这些脉动阵列的处理元件（PE）中的瞬时故障引起的错误。还讨论了使用这两种方法增加容错能力时的空间和时间开销的比较

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