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首页> 外文期刊>Pomiary Automatyka Kontrola >Pipelined architecture of a chaotic pseudo-random number generator in a Cyclone V SoC device
【24h】

Pipelined architecture of a chaotic pseudo-random number generator in a Cyclone V SoC device

机译：Cyclone V SoC器件中的混沌伪随机数生成器的流水线架构

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摘要

In this paper, we present a novel, optimized microarchitecture of a pseudorandom number generator (PRNG) based on the chaotic model with frequency dependent negative resistances (FDNR). The project was focused on optimization of the PRNG architecture to achieve the highest possible output throughput of the generated pseudo-random sequences. As a result we got a model of the pipelined PRNG that was implemented in Cyclone V SoC from Altera and verified experimentally. All versions of the PRNG were tested by standard statistical tests NIST SP800-22. In addition, we also provide a brief comparison with the PRNG implementation in SoC from Xilinx.
机译：在本文中，我们提出了一种新型的，优化的微体系结构的伪随机数生成器（PRNG），它基于具有频率依赖性负电阻（FDNR）的混沌模型。该项目专注于PRNG架构的优化，以实现所生成的伪随机序列的最高可能的输出吞吐量。结果，我们得到了Altera的Cyclone V SoC中实现的流水线PRNG模型，并进行了实验验证。 PRNG的所有版本均通过标准统计测试NIST SP800-22进行了测试。此外，我们还简要介绍了Xilinx在SoC中的PRNG实现。

著录项

  • 来源
    《Pomiary Automatyka Kontrola》 |2015年第7期|287-289|共3页
  • 作者

    Pawel DABAL; Ryszard PELKA;

  • 作者单位

    MILITARY UNIVERSITY OF TECHNOLOGY, FACULTY OF ELECTRONICS 2 Gen. Sylwestra Kaliskiego St., 00-908 Warszawa, Poland;

    MILITARY UNIVERSITY OF TECHNOLOGY, FACULTY OF ELECTRONICS 2 Gen. Sylwestra Kaliskiego St., 00-908 Warszawa, Poland;

  • 收录信息
  • 原文格式 PDF
  • 正文语种 eng
  • 中图分类
  • 关键词

    chaotic system; random number generators; FPGA; SoC;

    机译：混沌系统随机数生成器;FPGA;片上系统;

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