A 70-MHz 1.2- mu m CMOS 16-point DFT processor

Linderman R.W.; Shephard C.G.

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A 70-MHz 1.2- mu m CMOS 16-point DFT processor

机译：70MHz1.2μmCMOS 16点DFT处理器

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A chip architecture designed to compute a 16-point discrete Fourier transform (DFT) using S. Winograd's algorithm (1978) every 457 ns is presented. The 99500-transistor 1.2- mu m chip incorporates arithmetic, control, and input/output circuitry with testability and fault detection into a 144-pin package. A throughput of 2.3*10/sup 12/ gate-Hz/cm/sup 2/ and 79-million multiplications/s is attained with 70-MHz pipelined bit-serial logic. Combined with similar chips computing 15- and 17-point DFTs, 4080-point DFTs can be computed every 118 mu s. Using the 16- and 17-point chips, 272*272-point complex data imagery can be transformed in 4.25 ms. A 24-bit block floating-point data representation combined with an adaptive scaling algorithm delivers a numerical precision of 106 dB (17.6 bits) after computing 4080-point DFTs.

机译：提出了一种芯片体系结构，该体系结构设计为每457 ns使用S. Winograd算法（1978）计算16点离散傅立叶变换（DFT）。 99500晶体管1.2微米芯片在144引脚封装中集成了算术，控制和输入/输出电路以及可测试性和故障检测功能。使用70 MHz流水线位串行逻辑，可实现2.3 * 10 / sup 12 / gate-Hz / cm / sup 2 /和7900万次乘法/ s的吞吐量。结合计算15点和17点DFT的类似芯片，每118毫秒可以计算4080点DFT。使用16点和17点芯片，可以在4.25毫秒内转换272 * 272点的复杂数据图像。在计算4080点DFT之后，结合自适应缩放算法的24位块浮点数据表示形式可提供106 dB（17.6位）的数值精度。

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来源
《IEEE Journal of Solid-State Circuits》 |1988年第2期|P.343-350|共8页
作者
Linderman R.W.; Shephard C.G.;
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作者单位

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收录信息美国《科学引文索引》(SCI);美国《工程索引》(EI);
原文格式 PDF
正文语种 eng
中图分类一般性问题;基本电子电路;
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