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首页> 外文期刊>IEEE Journal of Solid-State Circuits >R, G, B acquisition interface with line-locked clock generator for flat panel display
【24h】

R, G, B acquisition interface with line-locked clock generator for flat panel display

机译：R，G，B采集接口，带锁相时钟发生器，用于平板显示器

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This paper presents the analysis, design, and experimental results of a triple 8-bit, 80 Msamples/s analog-to-digital acquisition channel with gain and clamp controls, together with a sample clock regenerator. While today's liquid crystal display (LCD) driver systems require some ten analog integrated circuits, this single chip offers three 7.4 effective bit 300 MHz bandwidth acquisition channels, sampled by a 250 ps rms long-term jitter regenerated clock. This new level of integration and performances is reached through the implementation of a new clock regenerator architecture. The integrated circuit, available in a 100-pin plastic package, is realized in a 13 GHz, 1 /spl mu/m BiCMOS process and measures 25 mm/sup 2/. It dissipates 1 W from 5 V supplies.
机译：本文介绍了具有增益和钳位控制的三路8位，80 Msamples / s模数采集通道以及一个采样时钟再生器的分析，设计和实验结果。尽管当今的液晶显示器（LCD）驱动器系统需要大约十个模拟集成电路，但该芯片提供了三个7.4有效位300 MHz带宽采集通道，并由250 ps rms的长期抖动再生时钟采样。通过实现新的时钟再生器体系结构，可以达到更高的集成度和性能水平。该集成电路采用100引脚塑料封装，以13 GHz，1 / splμm/ m的BiCMOS工艺实现，尺寸为25mm / sup 2 /。它从5 V电源消耗1 W功率。

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