A 3/5 V compatible I/O buffer

Pelgrom M.J.M.; Dijkmans E.C.

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A 3/5 V compatible I/O buffer

机译：3/5 V兼容的I / O缓冲器

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The design of a digital input/output buffer is described for operation in 3.3-V IC's with 5-V input signals. The design has been processed in 0.8- and 0.6-/spl mu/m CMOS processes. A comparison of results is presented.

机译：描述了用于在具有5V输入信号的3.3V IC中工作的数字输入/输出缓冲器的设计。该设计已经以0.8和0.6- / splμ/ m CMOS工艺进行了处理。给出了结果的比较。

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来源
《IEEE Journal of Solid-State Circuits》 |1995年第7期|P.823-825|共3页
作者
Pelgrom M.J.M.; Dijkmans E.C.;
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作者单位

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收录信息美国《科学引文索引》(SCI);美国《工程索引》(EI);
原文格式 PDF
正文语种 eng
中图分类一般性问题;基本电子电路;
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