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CPLDやVHDL設計の入門用教材に最適な:LCDクロックの製作

机译:适用于简介CPLD和VHDL设计简介:LCD时钟的生产

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摘要

製作例の第1弾は時計です(写真6-1).かつてはディジタル回路の入門用であった時計も,ワンチップ化されて以後は,単なる「組み立てキット」くらいのイメージしかなくなってしまいました.しかし,CPLDやVHDL設計の入門用としては,いまだにうってつけのアイテムではないかと思われます.時計は,混み入った制御がなく,フィードバック系もないので,前段側より少しずつ働かせていけば,問題が起きたときのデバッグも容易です.なにより,仕様に関しては誰しもが熟知しているのですから,あとは回路をどう突現するかの問題となるわけです.
机译:第一个制作例子是手表(照片6-1)。 用于引入数字电路的时钟也是一次削减的,并在“装配套件”的图像之后。 但是,它仍被认为是引入CPLD和VHDL设计的完美项目。 该时钟没有拥挤的控制,没有反馈系统,所以如果你的工作小于前面,那么在发生问题时易于调试。 最重要的是,因为每个人都熟悉规范,如果电路将投票将是一个问题。

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