IBISモデルの基礎と応用：手軽に使えるI/Oバッファ·モデル

河村隆二

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IBISモデルの基礎と応用：手軽に使えるI/Oバッファ·モデル

机译：IBIS模型的基础和应用：易于使用的I / O缓冲模型

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IBIS（I/O Buffer Information Specification）モデルとは，CPUやメモリおよびFPGAなどの高速ディジタル回路のシグナル·インテグリティ（信号品質）解析を行うためのI/Oバッファ·モデルです（図1）．IBISモデルを活用することによって，試作する前に配線長やトポロジはどのようにすればよいのか，終端はどのようにすればよいのか，シリーズ抵抗はどのくらいにすればよいのか，クロストークの影響を抑えるのにはどのくらいの配線間隔が必要なのか，などの検討が可能になります．また，IBISモデルはチップ全体のピン·アサインの情報も持っているので，CADデータ上のチップに直接モデルを割り当てることができ，基板設計後のレイアウト·データを使った一括シミュレーションを行えます．

机译：IBIS（I / O缓冲信息规范）模型是用于执行信号完整性（信号质量）分析的I / O缓冲模型，例如CPU，存储器和FPGA等高速数字电路（图1）。通过利用IBIS模型，在试生产之前，应在试生产之前进行布线长度或拓扑的长度，串联电阻应该多长时间，或者串联阻力应该多长时间，并且串扰的效果可以考虑如何长时间需要布线间隔来抑制它。此外，由于IBIS模型还具有整个芯片的引脚分配信息，因此可以将模型直接分配给CAD数据的芯片，并且可以在板设计后使用布局数据进行批量模拟。

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来源
《トランジスタ技術》 |2009年第538期|共9页
作者
河村隆二;
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作者单位

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收录信息
原文格式 PDF
正文语种 jpn
中图分类半导体三极管（晶体管）;
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1. IBISモデルの基礎と応用：手軽に使えるI/Oバッファ·モデル [J] . 河村隆二トランジスタ技術 . 2009,第7a538期

机译：IBIS模型的基础和应用程序：易于使用的I / O缓冲区模型
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