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AK1542Aを使った400MHz帯PLL周波数シンセサイザの設計と評価

机译:使用AK1542A的400 MHz带PLL频率合成器的设计与评估

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摘要

低消費電流で低雑音仕様のAK1542A(旭化成エレクトロニクス)と低位相雑音VCOを組合わせたPLL周波数シンセサイザを「PLL Designツール」を使って設計します.位相雑音特性に注目して,カットオフ周波数左の違いで位相雑音の形が,どのように変化するかを実験します.また,最も効率よく位相雑音を合成するf_cの最適値は,どこかを考えます.
机译:低电流消耗采用PLL频率合成器设计了使用“PLL设计工具”的低噪声规范AK1542A(Asahi Kasei Electronics)和低相位噪声VCO。 专注于相位噪声特性,我们将尝试由于截止频率之间的差异而改变相位噪声的形状。 此外,考虑最佳的F_C的最佳值,它最有效地结合了相位噪声。

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