シングルタイルJPEG2000コーデックのシステム構成

増崎隆彦; 筒井弘; 尾上孝雄水野雄介佐々木元中村行宏

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シングルタイルJPEG2000コーデックのシステム構成

机译：单曲瓷砖jpeg2000编解码系统的组成

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高解像度ディジタル画像を処理するJPEG2000コーデックLSIのシステムアーキテクチャを提案する．画質劣化を抑えるためにシングルタイル処理を行う場合，オンチップのメモリ量およびコア外部との入出力データ量が膨大になる恐れがある．そこで本稿では，ラインベースDWTと呼ばれる二次元DWTを使用し，データを短冊状に分割して処理するシステム構成を採用したシステムアーキテクチャを提案する．また，対応画像サイズ，コア内でのDWTの段数，中間データの内部保持可否に対し，各種構成に必要となるリソースを包括的に求め，効率的なシステム構成を検討する手法についても述べる．本システム構成に基づき，8,192×8,192の画像をシングルタイルで処理可能なJPEG2000コーデックLSIを実装した結果，回路規模は2.1Mゲート，消費電力はI/O 3.3V，Core 1.8V，27MHzでの符号化時に137.1 mWであった．

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来源
《画像電子学会誌》 |2009年第200期|296-304|共9页
作者
増崎隆彦; 筒井弘; 尾上孝雄水野雄介佐々木元中村行宏;
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作者单位

立命館大学総合理工学研究機構;

京都大学大学院情報学研究科通信情報システム専攻;

株式会社メガチップス大阪大学大学院情報科学研究科情報システム工学専攻;

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