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逻辑功能模块与可编程逻辑门阵列

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本申请提供一种逻辑器件与布线较为简化的可编辑逻辑门阵列与逻辑功能模块。逻辑功能模块中的比特算法单元用于执行一个比特字节的多元加法运算或者减法运算，包括查找表、第一多路复用器、第二多路复用器及全加器。查找表用于对多个输入信号进行第一次加法逻辑运算，第一多路复用器连用于选择性输出第一级进位链提供第一级进位或者查找表提供的进位作为第一级进位链的进位输出。全加器用于针对第一级进位链的进位输出、多元加数的和及自第二级进位链接收的第二级进位链进位执行第二次加法运算，获得多个输入信号的和以及对应第二级进位链的全加进位。第二多路复用器用于将全加器输出的多个输入信号的和输出并作为比特算法单元的逻辑运算和。

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公开/公告号CN114253508A

专利类型发明专利
公开/公告日2022-03-29

原文格式PDF
申请/专利权人华为技术有限公司;
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申请/专利号CN202010997577.X
发明设计人张扬;朱佳凯;胡值彬;李磊;
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申请日2020-09-21
分类号G06F7/50(20060101);G06F7/501(20060101);G06F16/22(20190101);
代理机构44202 广州三环专利商标代理有限公司;
代理人熊永强;李稷芳
地址 518129 广东省深圳市龙岗区坂田华为总部办公楼
入库时间 2023-06-19 14:42:14

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法律状态信息

法律状态
2022-03-29

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