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CONVERSION OF A SYNCHRONOUS FPGA DESIGN INTO AN ASYNCHRONOUS FPGA DESIGN

机译:将同步FPGA设计转换为异步FPGA设计

摘要

Methods and systems for converting synchronous circuit designs to asynchronous circuit designs are described. A method may include converting a synchronous circuit design to an asynchronous dataflow design. Functional characteristics of the synchronous circuit design may be determined. The synchronous circuit design may include multiple synchronous logic blocks and a number of connection boxes. Each synchronous logic block may be converted, based on functional characteristics, to corresponding asynchronous dataflow logic blocks. The corresponding asynchronous dataflow logic blocks may provide corresponding asynchronous dataflow logic functions that may use protocol signals. Each connection box, based on the functional characteristics, may be converted to programmable switch points and programmable switches.
机译:描述了用于将同步电路设计转换为异步电路设计的方法和系统。一种方法可以包括将同步电路设计转换为异步数据流设计。可以确定同步电路设计的功能特性。同步电路设计可以包括多个同步逻辑块和多个接线盒。可以基于功能特性将每个同步逻辑块转换为相应的异步数据流逻辑块。相应的异步数据流逻辑块可以提供可以使用协议信号的相应的异步数据流逻辑功能。根据功能特性,每个接线盒都可以转换为可编程开关点和可编程开关。

著录项

  • 公开/公告号EP2100242B1

    专利类型

  • 公开/公告日2017-11-22

    原文格式PDF

  • 申请/专利权人 ACHRONIX SEMICONDUCTOR CORP.;

    申请/专利号EP20070870125

  • 发明设计人 MANOHAR RAJIT;

    申请日2007-12-31

  • 分类号G06F17/50;

  • 国家 EP

  • 入库时间 2022-08-21 13:19:01

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