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ADAPTIVE LAYOUT CACHE ORGANIZATION TO ENABLE OPTIMAL CACHE HARDWARE PERFORMANCE

机译:自适应布局缓存组织以实现最佳缓存硬件性能

摘要

A cache memory mapping algorithm and associated hardware maps cache lines in a manner such that each set contains cache lines from only one cache memory chip. Sequential disk accesses are mapped to sequential sets to allow stored data to be retrieved simultaneously from different cache storage chips. The cache line allocation policy ensures that new cache lines are dynamically inserted into the proper sets and correspond to the correct cache memory chip.
机译:高速缓存存储器映射算法和相关联的硬件以这样的方式映射高速缓存线,使得每一组仅包含来自一个高速缓存存储器芯片的高速缓存线。顺序磁盘访问被映射到顺序集,以允许从不同的缓存存储芯片中同时检索存储的数据。高速缓存行分配策略可确保将新的高速缓存行动态插入适当的组中,并与正确的高速缓存存储芯片相对应。

著录项

  • 公开/公告号KR100891009B1

    专利类型

  • 公开/公告日2009-03-31

    原文格式PDF

  • 申请/专利权人

    申请/专利号KR20067011280

  • 发明设计人 로이어 로버트 2세;

    申请日2006-06-08

  • 分类号G06F12/08;G06F9/40;

  • 国家 KR

  • 入库时间 2022-08-21 19:12:04

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