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RAM Controller for 2-D Discrete Cosine Transform and Inverse Discrete Cosine Transform

机译:用于二维离散余弦变换和反向离散余弦变换的RAM控制器

摘要

The present invention relates to a RAM controller for DCT / IDCT, and provides a dual-port RAM configured using four sub-dual port RAMs to receive data input start signal (DBS) and clock (CLK) signals to control the RAM. , A counter, a pre-address generating means, an address generating means, a first multiplexer, a state machine, and a read enable generating means to reduce the size of the DCT / IDCT element.
机译:本发明涉及一种用于DCT / IDCT的RAM控制器,并提供一种使用四个子双端口RAM配置的双端口RAM,以接收数据输入开始信号(DBS)和时钟(CLK)信号以控制RAM。计数器,预地址产生装置,地址产生装置,第一多路复用器,状态机和读取使能产生装置,以减小DCT / IDCT元件的尺寸。

著录项

  • 公开/公告号KR950030682A

    专利类型

  • 公开/公告日1995-11-24

    原文格式PDF

  • 申请/专利权人 배순훈;

    申请/专利号KR19940009509

  • 发明设计人 김성정;

    申请日1994-04-30

  • 分类号H04N7/13;

  • 国家 KR

  • 入库时间 2022-08-22 03:46:11

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