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DVB-S2系统中LDPC变码率编码硬件实现

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DVB-S2是卫星宽带业务的第二代标准，本文首先分析了DVB-S2中LDPC码的特点,给出了一种面向FPGA的LDPC码变码率编码实现方案,并采用Verilog HDL语言在Virtex4 xc4vlx60芯片上实现了变码率编码器的设计;设计采用多个BlockRAM存储校验位,实现了与同一信息位关联的所有校验位的并行处理,提高了编码速度;综合结果表明:该编码器的吞吐量约为49.95Mbps,在占用资源较少的情况下满足了DVB-S2标准的要求.

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来源
《2009年全国无线电应用与管理学术会议》|2009年|433-438|共6页
会议地点重庆
作者
Yan Ying; 阎英; Zhang Wen jun; 张文俊; Liu Bo hong; 刘伯红;
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作者单位

中国通信学会;

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会议组织
正文语种
原文格式 PDF
中图分类 TN927.2;
关键词
卫星宽带业务; 低密度奇偶校验码; 变码率编码器; 硬件平台; 仿真分析;

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