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基于BM算法的RS译码器的FPGA优化实现

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本文研究了一种新提出的利用Berlekamp-Massey(BM)算法实现高速RS译码器的VLSI结构,引入了GF(28)域适合FPGA实现的比特串行乘法器并改进了译码器结构.最后,给出了基于该改进结构的RS(255,239)译码器的性能.

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来源
《中国电子学会信息论分会第十三届学术年会》|2005年|60-65|共6页
会议地点长沙
作者
李宏; 王世练; 张尔扬;
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作者单位

中国电子学会;

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会议组织
正文语种
原文格式 PDF
中图分类信道编码理论;
关键词
BM算法; Galois域乘法; RS译码器; FPGA;

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