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基于FPGA的高速数字串行加法器及其在匹配滤波器中的应用

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摘要

与传统加法器相比,数字串行加法器具有工作频率高、占用资源少、设计灵活的优点,本文首先介绍了数字串行加法器的原理,详细说明了该加法器在FPGA上的实现要点以及在匹配滤波器设计中的应用.

著录项

来源
《第四届中国通信专用集成电路发展战略高级研讨会》|2002年|139-143|共5页
会议地点深圳
作者
薛小刚; 钟信潮;
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作者单位

中国电子学会;

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会议组织
正文语种
原文格式 PDF
中图分类算法理论;
关键词
加法器; 位并行; 数字串行; FPGA; 匹配滤波器; 集成电路;

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