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首页> 外文会议>2017 International Conference on Inventive Computing and Informatics >Performance analysis of QC-LDPC codes with girth 6 using Log Domain sum product algorithm
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Performance analysis of QC-LDPC codes with girth 6 using Log Domain sum product algorithm

机译：使用对数域和积算法的第6周长QC-LDPC码性能分析

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This paper presents Bit error Rate performance Analysis of Quasi Cyclic Low Density Parity Check Codes (QC-LDPC) with girth 6 using Log Domain sum product and Simple Log Domain Sum Product Algorithm for Decoding. The approach to construct Parity Check matrix for LDPC codes is based on sparse Lower Upper decomposition. Then to create QC-LDPC matrix counter shifting, interleave mapping, Set XORing, Circulant Shifting and Randomization processes are being used. The constructed QC-LDPC codes is of a girth 6 on / code Rate have row weight 6 and column weight 3. Bit error rate performance is done through simulation to be calculated for various code length such as code I (960, 480), code II (1980, 990) and code III (1080, 540).
机译：本文使用对数域总和乘积和简单对数域总和乘积算法，对周长为6的准循环低密度奇偶校验码（QC-LDPC）的误码率性能进行了分析。 LDPC码的奇偶校验矩阵的构造方法基于稀疏的Lower Upper分解。然后，要创建QC-LDPC矩阵计数器移位，将使用交织映射，Set XORing，循环移位和随机化过程。构造的QC-LDPC码的围长为6，/码率的行权重为6，列权重为3。通过模拟来计算误码率，以计算各种码长，例如码I（960，480），码。 II（1980，990）和代码III（1080，540）。

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