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Design and testing of SDH equipment clock (SEC) in SDH 155 Mbit/s system

机译:SDH 155 Mbit / s系统中SDH设备时钟(SEC)的设计和测试

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摘要

We present a practical design of the SDH equipment clock (SEC) in an SDH 155 Mbit/s system (STM-1 hierarchical level) and the results of testing the transfer function, output wander, and short-term and long-term phase transient responses.
机译:我们介绍了SDH 155 Mbit / s系统(STM-1分层级别)中SDH设备时钟(SEC)的实用设计以及传递函数,输出漂移以及短期和长期相位瞬变的测试结果回应。

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