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首页> 外文会议>IEEE International Conference on Quantum Computing and Engineering >Improving performance of logical qubits by parameter tuning and topology compensation
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Improving performance of logical qubits by parameter tuning and topology compensation

机译：通过参数调整和拓扑补偿来提高逻辑量子位的性能

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Optimization or sampling of arbitrary pairwise Ising models, in a quantum annealing protocol of constrained interaction topology, can be enabled by a minor-embedding procedure. The logical problem of interest is transformed to a physical (device programmable) problem, where one binary variable is represented by a logical qubit consisting of multiple physical qubits. In this paper we discuss tuning of this transformation for the cases of clique, biclique, and cubic lattice problems on the D-Wave 2000Q quantum computer. We demonstrate parameter tuning protocols in spin glasses and channel communication problems, focusing on anneal duration, chain strength, and mapping from the result on physical qubits back to the logical space. Inhomogeneities in effective coupling strength arising from minor-embedding are shown to be mitigated by an efficient reweighting of programmed couplings, accounting for logical qubit topology.
机译：在约束交互拓扑的量子退火协议中，可以通过次要嵌入过程来实现对任意成对伊辛模型的优化或采样。感兴趣的逻辑问题转换为物理（设备可编程）问题，其中一个二进制变量由包含多个物理量子位的逻辑量子位表示。在本文中，我们讨论了在D-Wave 2000Q量子计算机上针对集团，双斜度和立方晶格问题的情况对这种变换进行的调整。我们演示了自旋玻璃和通道通信问题中的参数调整协议，重点关注退火持续时间，链强度以及从物理qubit的结果映射回逻辑空间的映射。由于对逻辑量子位拓扑结构的考虑，通过对编程耦合进行有效的加权，可以减轻因小嵌入而引起的有效耦合强度的不均匀性。

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