Charge Pump DPLL to Operate at High Frequencies

机译：电荷泵DPLL以高频运行

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This work presents a pre-charge type DPLL that can be used as a clock recovery circuit in SDH/SONET communication protocols at 622 MHz. It is presented the phase/frequency detector which can operate equally at low and high frequencies. Each block of the DPLL is described, calculated and simulated. It is also presented the stability criteria and analysis of the DPLL and its final layout. The main feature of this work is the quick synchronization time of the DPLL due to the inclusion of an initialization circuit.

机译：这项工作提出了一种预充电型DPLL，可在622 MHz的SDH / SONET通信协议中用作时钟恢复电路。呈现相位/频率检测器，其可以在低频和高频下同样操作。描述，计算和模拟的每个DPL1块。还介绍了DPLL及其最终布局的稳定性标准和分析。由于包含初始化电路，这项工作的主要特征是DPLL的快速同步时间。

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来源
《IFIP TC10 WG10.5 international conference on very large scale integration》|1997年||共12页
会议地点
作者
L.Mesquita; T.C.Pimenta;
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作者单位

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会议组织
原文格式 PDF
正文语种
中图分类大规模集成电路、超大规模集成电路;
关键词
PLL; DPLL; PFD; VCO; syncronization.;

机译：PLL;PLL;PFD;VCO;同步。;

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