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ASIC design for cell search in 3GPP W-CDMA

机译：3GPP W-CDMA中的细胞搜索的ASIC设计

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This paper deals with an ASIC design and realization for a pipelined cell search algorithm in the 3GPP W-CDMA system. Pipelining three stages of cell search provides preferable performance, but also results in greed for high computing power. The ASIC implementation furnishes this computing power demand with a high-performance, cost-effective, and low-power solution. In the ASIC design, two synchronization code matched correlators are well designed and realized with reduced computing power. A weighted Comma-Free Reed-Solomon decoder is also proposed with superior performance, and realized in cost-effective and low-power architecture. Finally, the cell search chip is designed in a 3.3-V 0.35-μm CMOS technology with 4 × 4 mm{sup}2 core area and 1.32 W power dissipation, complying with the 3GPP W-CDMA system specifications.
机译：本文涉及3GPP W-CDMA系统中的流水线小区搜索算法的ASIC设计和实现。管制三个阶段的小区搜索提供了优选的性能，也可以导致贪婪的高计算能力。 ASIC实现提供了具有高性能，经济高效和低功耗解决方案的计算电源需求。在ASIC设计中，两种同步码匹配的相关器是精心设计的，并且通过减少计算功率实现。还提出了一种加权逗号无资源芦苇芦荟解码器，具有卓越的性能，并实现了成本效益和低功耗的架构。最后，小区搜索芯片设计为3.3V 0.35微米的CMOS技术，具有4×4毫米{SUP} 2核心区域和1.32 W功耗，符合3GPP W-CDMA系统规格。

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