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脉冲发生器时钟模块与输出模块设计

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第一章 绪论

1.1 研究背景与意义

1.2 脉冲相关技术国内外发展现状

1.3 本文的主要任务与结构

第二章 总体方案设计

2.1 脉冲时钟模块方案设计

2.2 脉冲输出模块方案设计

2.3 本章小结

第三章 硬件电路设计

3.1 脉冲时钟模块电路设计

3.2 脉冲输出模块电路设计

3.3 电路可靠性设计

3.4 电路板布局布线与匹配设计

3.5 本章小结

第四章 电路输出模块校准设计

4.1 脉冲调理输出模块误差分析

4.2 通道校准

4.3 校准流程

4.4 本章小结

第五章 电路调试与测试结果

5.1 电路调试与分析

5.2 项目指标测试

5.3 本章小结

第六章 结束语

致谢

参考文献

攻硕期间取得的科研成果

附录

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摘要

随着半导体技术的发展、新型化设备的研制,脉冲信号不仅有高速、窄脉宽、分辨率高的要求,而且提出了信号电平精密可调、幅度范围大、沿可选的要求。为了满足现代测试的需求,本文对脉冲发生器时钟产生模块与输出模块展开研究,深入地分析了高精度差分时钟信号产生技术以及宽频大幅度电平精密可调且沿可选的脉冲信号调理技术。主要内容包括:
  (1)宽频低抖动时钟产生技术研究
  时钟信号作为波形合成的激励,其频率范围、精度、稳定度是电路设计难点,通过与传统时钟产生方法进行对比,本文提出了基于集成锁相环技术的时钟产生技术,并对电路设计关键技术进行了分析,以提高时钟产生电路的输出频率精度、分辨率、频率范围,降低时钟产生电路中相位噪声。
  (2)宽频带大幅度输出、电平精密可控调理技术的研究
  传统线性放大电路由于受器件带宽限制无法实现高速脉冲信号的调理,本文针对项目要求并结合教研室通道调理技术经验,设计了一种基于差动结构的非线性调理电路,并通过精密可控恒流源、恒压源的电路设计来完成输出脉冲信号的幅度、偏移精密可调的要求。
  (3)脉冲调理电路校准方法的研究
  电路设计中由于所使用器件本身制作工艺、材料的限制,测量值与标称值之间不可避免的会产生误差。为了实现电路的校准,本文对输出模块误差进行分析,并对常用校准方法进行比较,结合本项目的特点,最终采用了分段式多项式拟合的方法来对标称值修正,使得输出信号性能指标满足要求。
  通过对脉冲发生器时钟产生模块与输出模块的研究,实现了宽频率、高精度、高稳定性时钟输出,宽频大幅度、电平精密可控的输出模块电路设计。

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