基于FPGA的万兆以太网UDP_IP硬件协议栈设计与实现

董永吉; 王钰; 袁征

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基于FPGA的万兆以太网UDP_IP硬件协议栈设计与实现

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针对传统基于软件的协议栈无法满足高速数据传输处理需求的问题,提出了一种基于硬件加速的UDP协议栈设计方案,该方案基于硬件高效并行的特点,实现了UDP/IP协议栈,满足了万兆以太网数据高带宽传输的需求。通过实际测试表明,该设计最高可以达到9.32 Gbps传输速率,满足10 Gbps带宽下线速处理的需求,与传统软件实现相比,处理能力更接近理论极限。

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来源
《计算机应用研究》 |2022年第8期|2465-2468|共4页
作者
董永吉; 王钰; 袁征;
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作者单位

解放军战略支援部队信息工程大学;

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原文格式 PDF
正文语种 chi
中图分类计算机网络;
关键词
FPGA; 万兆以太网; 硬件协议栈; UDP协议;

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