高吞吐率浮点FFT处理器的FPGA实现研究

牟胜梅; 杨晓东

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受浮点操作的长流水线延迟及FPGA片上RAM端口数目的限制,传统FFT处理器的吞吐率通常只能达到每周期输出一个复数结果.本文用FPGA设计并实现了一种高吞吐率的IEEE 754标准单精度浮点FFT处理器,通过改进蝶形计算单元的结构并重新组织FPGA片上RAM的访问,该处理器每周期平均可输出约两个复数计算结果,吞吐率约为传统FFT处理器吞吐率的两倍.对于1 024点FFT变换,可在(512+10)*10=5 220周期内完成.

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来源
《计算机工程与科学》 |2008年第7期|98-99117|共3页
作者
牟胜梅; 杨晓东;
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作者单位

国防科技大学计算机学院;

湖南;

长沙;

410073;

国防科技大学计算机学院;

湖南;

长沙;

410073;

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原文格式 PDF
正文语种 chi
中图分类设计与性能分析;
关键词
FPGA; FFT; 蝶形单元; 3输入浮点加法器;

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