微处理器中异步FIFO的一种优化方法

刘涛; 张盛兵; 黄小平

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微处理器中异步FIFO的一种优化方法

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在VLSI电路设计中,一个系统包含了多个时钟域,如何在这些不同的时钟域之间传递数据成了一个重要问题;在微处理器总线接口等多时钟系统中,采用异步FIFO传递数据是一种安全高效的方法,提出了一种优化的异步FIFO设计,以异步的方式产生标志信号,根据排队论确定最优的FIFO深度,并引入门控时钟技术降低了动态功耗;与其它设计相比,电路结构简单,在面积和功耗方面得到了改善,可以广泛在嵌入式微处理器中使用.

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来源
《计算机测量与控制》 |2009年第1期|148-150159|共4页
作者
刘涛; 张盛兵; 黄小平;
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作者单位

西北工业大学航空微电子中心;

陕西;

西安;

710072;

西北工业大学航空微电子中心;

陕西;

西安;

710072;

西北工业大学航空微电子中心;

陕西;

西安;

710072;

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原文格式 PDF
正文语种 chi
中图分类总体结构、系统结构;
关键词
异步FIFO; 微处理器; 总线接口;

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