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郑争兵;
陕西理工学院电信工程系;
FPGA; UART; 有限状态机;
机译:使用HSTL I / O标准的基于28nm FPGA的功耗优化UART设计
机译:基于FPGA的高效多通道UART控制器的新型设计
机译:基于SRAM的FPGA的一种新型可配置边界扫描电路设计
机译:在FPGA中使用BIST技术实现UART。
机译:一种基于FpGa的算法基于统计的定位的实时解决方案的设计
机译:基于电压缩放的高效UART设计及其在7系FPGA上的实现
机译:基于单事件翻转发生率的基于sRam的FpGa设计中的容错实现
机译:DUT FPGA一种测试架构,具有基于FPGA的硬件加速器模块,可独立测试多个器件
机译:用于微控制器的异步接收器,尤其是UART,具有改进的电路设计,可以更快地从待机模式切换到工作模式
机译:设计电路系统,扩展现有方法以评估电路设计的可行性,执行电路设计的可行性评估,完善电路设计的第一决策规则,形成电路设计的第二决策规则的方法电路设计,用于为多个预先设计的电路块组织设计者的经验数据,提高胶粘逻辑分配效率,并在设计块之间分配胶粘的多个逻辑元素,并分配胶粘逻辑以在集成电路设备设计中执行方案,转换特定于电路块的接口,选择电路收集器,设计一种包含使能设备测试以验证a正确操作的设备,并开发行为测试台,项圈接口和接口系统
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