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薛天志; 刘百成; 陈松;
中国科学技术大学;
脉冲卷积神经网络电路; 手写体识别; 数字集成电路;
机译:ITS应用中基于DSRC的传感器节点的FM0 / Manchester编解码器的VLSI架构设计具有100%的硬件利用率
机译:一种高效硬件的多分辨率块匹配算法及其VLSI架构,适用于像MPEG的高清MPEG视频编码器
机译:一种基于卷积神经网络的新型硬件取向超高速物体检测算法
机译:一种VLSI架构设计,具有较低的硬件成本和更少的内存,可用于二维离散小波变换
机译:一种新颖的双边沿触发脉冲时钟TSPC D触发器,适用于高性能和低功耗VLSI设计应用。
机译:模拟的肌肉纺锤体和刺突传入验证了VLSI神经形态硬件是否可作为感觉运动功能和疾病的试验台
机译:一种字节智能CRC发生器芯片的硬件设计和VLsI实现
机译:使用跨层次差异的Bat azimuthal回声定位:基于VLsI的硬件系统的建模和实现。
机译:一种训练卷积神经网络进行物理产品模拟的方法,一种进行模拟物理产品和卷积神经网络的对应方法
机译:可部署应用程序的智能家用路由器平台的硬件和网络基础架构设计
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