基于VerilogHDL的IP核参数化设计

徐晨; 袁红林

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基于VerilogHDL的IP核参数化设计

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指出了IP核参数化设计的重要性,分析了IP核的参数类型及相互关系。在分析基于VerilogHDL的IP核参数化设计方法及所面临困难的基础上,提出了一种附加的编译预处理方法并设计了相应的工具软件ECP。IP核由VerilogHDL和ECP扩展的语句混合编程,经ECP处理后生成VerilogHDL源文件。应用该方法后,提高了Ver-ilogHDL在描述功能、性能、结构及优化策略等参数化的复杂模型时所需要的灵活性,增强了VerilogHDL的建模能力。作为一个IP核参数化设计的实例,介绍了C*Core系统中断控制IP的参数化设计过程,给出了FPGA验证的结果。

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来源
《微电子学与计算机》 |2005年第12期|85-88|共4页
作者
徐晨; 袁红林;
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作者单位

南通大学江苏省专用集成电路设计重点实验室;

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原文格式 PDF
正文语种 chi
中图分类设计;
关键词
IP核; 参数化设计; VerilogHDL; 编译预处理; 中断控制IP;

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