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刘云涛; 王颖; 赵旦峰;
哈尔滨工程大学信息与通信工程学院;
采样保持; 全差分结构; 运算放大器;
机译:采用数字双极技术的100MHz 10mW 3V采样保持放大器的设计
机译:具有高达100MHz的66dB SFDR的CMOS正交电荷域采样电路
机译:流水线ADC的12bit 100MHz采样保持电路设计
机译:低功耗,高速采样保持电路,用于直接采样数字辐射计。
机译:关于用于采样数据系统中的采样间输出重构的最优分数保持电路
机译:一个33mW 12位100MHz采样保持放大器
机译:用于多个采样/第二集成电路的低于200皮秒的Gaas采样保持电路
机译:数字信号处理器应用电路及其采样保持电路的时钟供给电路(数字信号处理器应用电路及其采样保持电路的时钟供给电路)
机译:设计电路系统,扩展现有方法以评估电路设计的可行性,执行电路设计的可行性评估,完善电路设计的第一决策规则,形成电路设计的第二决策规则的方法电路设计,用于为多个预先设计的电路块组织设计者的经验数据,提高胶粘逻辑分配效率,并在设计块之间分配胶粘的多个逻辑元素,并分配胶粘逻辑以在集成电路设备设计中执行方案,转换特定于电路块的接口,选择电路收集器,设计一种包含使能设备测试以验证a正确操作的设备,并开发行为测试台,项圈接口和接口系统
机译:用于增加闪存ADC中采样保持电路带宽的电路设计技术
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