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RTL综合系统设计中时序逻辑综合的实现方法

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摘要

时序逻辑综合是 RTL综合系统设计中的一个重要部分。文章系统地论述了时序逻辑综合问题，在分析用户的 RTL描述形式的基础上，以具体算法的形式，提出基本时序逻辑电路描述综合的实现方法，同时对其它一些综合系统中未引用的复杂时序逻辑电路也提出了具体的综合实现方法。

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来源
《微电子学与计算机》 |2001年第1期|24-29|共6页
作者
袁媛; 谢巍; 刘明业;
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作者单位

北京理工大学ASIC研究所;

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正文语种 chi
中图分类 TN791.02;
关键词
RTL综合; 时序逻辑综合; 综合系统; VHDL; 设计;

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