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黄春行; 朱晓华;
南京理工大学电子工程与光电技术学院;
电子设计自动化; IBIS模型; SPICE模型; 输出缓冲器; 瞬态行为模型;
机译:可变输出电阻对LC传输线CMOS缓冲器瞬态响应的影响及其模型
机译:<![cdata [一个90-nm cmos 800 mhz 2 InlinemediaObject> $$ times $$ arequationsource> × MO> MATH> areATIONSOURCE> INLINEEQUATION> VDD输出缓冲器,具有泄漏检测和输出电流自动调整]]>
机译:自适应均衡器,具有根据65 nm CMOS技术用于10 Gb / s发射器的最小允许输出信号差分电压控制器和伪差分Cascode输出缓冲器
机译:使用简洁的SOI-SPICE模型对部分耗尽(PD)SOI CMOS器件中的单晶体管锁存行为进行建模
机译:使用Angelov模型在PSpice中对碳化硅(SIC)垂直结场效应晶体管(VJFET)进行紧凑建模,并使用SIC VJFET模型对PSpice模拟电路构建模块进行仿真。
机译:专业或业余吗?音韵输出缓冲器作为工作存储器运算符
机译:基于180nm CMOS技术的设备3.3 V输出缓冲器1.8 V.
机译:单片集成CmOs-mEms器件的spICE Level 3和BsIm3 v3.1特性
机译:CMOS输出缓冲器可减少电压负反馈单元的振荡(负反馈可减少CMOS输出缓冲器中的电压振荡)
机译:输入/输出缓冲器的电源噪声引起的抖动行为建模
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