一种AES算法的FPGA设计与快速实现

吴瑕; 周焰; 谷京朝

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一种AES算法的FPGA设计与快速实现

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针对AES算法特点,提出一种适于FPGA实现的改进的快速AES算法.本方案采用轮内流水线结构和密钥并行处理,ECB操作模式,并且可在一块芯片上同时支持128、192、256 bit三种密钥长度,因而在占用相对较少的逻辑资源下提高了系统吞吐率,并且极大的增强了其安全性和使用周期.通过优化的逻辑层次和时序设计,较好地解决了并行处理中的子密钥与轮函数的时序节拍与控制关系,给出了仿真图.实验结果表明该设计相比其他一些设计具有更高性能.

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来源
《系统工程与电子技术》 |2007年第10期|1773-1776|共4页
作者
吴瑕; 周焰; 谷京朝;
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作者单位

空军雷达学院研究生管理大队,湖北,武汉,430019;

空军雷达学院信息与指挥自动化工程系,湖北,武汉,430019;

空军雷达学院信息与指挥自动化工程系,湖北,武汉,430019;

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原文格式 PDF
正文语种 chi
中图分类安全保密;
关键词
AES; FPGA; 密钥; 流水线;

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