NMS译码算法中优化比例因子的FPGA LDPC译码器

李锦明; 张萍萍; 王兰珠; 王国栋

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NMS译码算法中优化比例因子的FPGA LDPC译码器

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针对低密度校验码(Llow-density parity-check,LDPC)归一化最小和NMS(Normalized minimum sum)译码算法中由于尺度因子的不确定性导致译码算法硬件实现困难的问题,以空间数据系统协商委员会(CCSDS)标准中(8177,7154)近地空间LDPC码为研究对象,提出了一种尺度因子可变的NMS译码算法,它利用现场可编程门阵列(FPGA)的移位特性对校验节点的量化数据进行优化,最终实现了LDPC译码器功能。仿真和实验结果表明,所设计的基于FPGA的LDPC译码器采用NMS译码算法中的变尺度因子提高了解码性能、简化了硬件结构,加快了收敛速度,提高了纠错能力。

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来源
《测试科学与仪器：英文版》 |2022年第4期|398-406|共9页
作者
李锦明; 张萍萍; 王兰珠; 王国栋;
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作者单位

中北大学仪器与电子学院;

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原文格式 PDF
正文语种 chi
中图分类 TN9;
关键词
LDPC码; NMS译码算法; 可变比例因子; 量化;

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