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IEEE International Conference on Computer Design
IEEE International Conference on Computer Design
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1.
IEEE P1149 Proposed Standard Testability Bus-An update with case histories
机译:
IEEE P1149提出了标准可测试性总线 - 具有案例历史的更新
作者:
Turino J.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
2.
Stop criteria in simulated annealing
机译:
停止模拟退火的标准
作者:
Otten R.H.J.M.
;
van Ginneken L.P.P.P.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
3.
Testing of VLSI regular arrays
机译:
测试VLSI常规阵列
作者:
Marnane W.P.
;
Moore W.R.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
4.
PARET; an integrated visual tool for the study of parallel systems
机译:
paret; 并行系统研究的集成视觉工具
作者:
Nichols K.M.
;
Edmark J.T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
5.
PLA based finite state machines using Johnson counters as state memories
机译:
PLA基于Johnson Counters作为州内记忆的PLA
作者:
Amann R.
;
Eschermann B.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
6.
A new class of symmetric error correcting/unidirectional error detecting codes
机译:
新的对称误差校正/单向错误检测代码
作者:
Jha N.K.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
7.
Integrated design and test synthesis
机译:
集成设计和测试合成
作者:
Gebotys C.H.
;
Elmasry M.I.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
8.
A proposed standard test bus and boundary scan architecture
机译:
建议的标准测试总线和边界扫描架构
作者:
Whetsel L.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
9.
Design of a 20 MHz 64-tap transversal filter
机译:
设计20 MHz 64分接横向滤波器
作者:
Stearns C.C.
;
Luthi D.A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
10.
Error tolerance in parallel simulated annealing techniques
机译:
并行模拟退火技术中的误差容限
作者:
Jayaraman R.
;
Darema F.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
11.
Parallel LU factorization for circuit simulation on an MIMD computer
机译:
MIMD计算机电路仿真的平行LU分解
作者:
Chen C.-C.
;
Hu Y.-H.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
12.
Optimization for automatic cell assembly
机译:
自动细胞组件优化
作者:
Dutt D.P.
;
Lakhani G.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
13.
Sorting on an array of processors
机译:
在一系列处理器上排序
作者:
Jagadish H.V.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
14.
Synthesis from VHDL
机译:
VHDL的合成
作者:
Lis J.S.
;
Gajski D.D.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
15.
Extension of a transistor level digital timing simulator to include first order analog behavior
机译:
晶体管级数字定时模拟器的扩展包括一阶模拟行为
作者:
Chadha R.
;
Chen C.-F.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
16.
Interconnection delay in very high-speed VLSI
机译:
非常高速VLSI的互连延迟
作者:
Zhou D.
;
Preparata F.P.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
17.
MILES: a mixed level simulator for analog/digital design
机译:
Miles:模拟/数字设计的混合水平模拟器
作者:
Stroucken A.C.J.
;
van de Ven G.J.J.M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
18.
Tera-Hertz study of normal and superconducting transmission lines
机译:
Tera-Hertz对正常和超导传输线的研究
作者:
Chi C.C.
;
Grischkowsky D.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
19.
A higher level hardware design verification
机译:
更高级别的硬件设计验证
作者:
Takahara A.
;
Nanya T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
20.
Generation of high speed CMOS multiplier-accumulators
机译:
高速CMOS倍增器累加器的产生
作者:
Pang K.F.
;
Soong H.-W.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
21.
Trace driven modelling and performance evaluation of tightly coupled multiprocessor systems
机译:
紧密耦合多处理器系统的跟踪驱动建模与性能评估
作者:
Luc K.-Q.
;
Ong S.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
22.
Cache-based pipeline architecture in the Hitachi H32/200 32-bit microprocessor
机译:
基于缓存的流水线架构在Hitachi H32 / 200 32位微处理器中
作者:
Nishimukai T.
;
Inayoshi H.
;
Takagi K.
;
Iwasaki K.
;
Kawasaki I.
;
Hanawa M.
;
Okada T.
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
关键词:
stack cache scheme;
20 MHz;
32 bit;
20-MHz clock rate;
7 MIPS;
Real-time Operating system Nucleus;
Hitachi H32/200;
32-bit microprocessor;
branch instructions;
four-entry cache;
1-K byte code cash;
cache memories;
register file;
general register set;
23.
The BACK algorithm for sequential test generation
机译:
顺序测试生成的后算法
作者:
Cheng W.-T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
24.
Processor design using path programmable logic
机译:
处理器设计使用路径可编程逻辑
作者:
Flanagan J.K.
;
Nelson B.E.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
25.
The design of the VLSI image-generator ZaP
机译:
VLSI图像生成器ZAP的设计
作者:
Saeijs R.W.J.J.
;
van Berkel C.H.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
26.
Parallel calculation of shortest paths in sparse graphs on a systolic array
机译:
Systolic阵列上稀疏图中最短路径的并行计算
作者:
Bauer S.
;
Schwiegelshohn U.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
27.
Analog circuit synthesis and exploration in OASYS
机译:
Oasys中的模拟电路合成与探索
作者:
Harjani R.
;
Rutenbar R.A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
28.
System interface of the NS32532 microprocessor
机译:
NS32532微处理器的系统接口
作者:
Sidi Y.
;
Maytal B.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
29.
Limits of backplane bus design
机译:
背板总线设计的限制
作者:
Borrill P.L.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
30.
CESAR-A programmable high performance systolic array processor
机译:
Cesar-A可编程高性能收缩阵列处理器
作者:
Toverud M.
;
Anderson V.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
31.
Large memory embedded ASICs
机译:
大型记忆嵌入式ASIC
作者:
Iizuka T.
;
Sakurai T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
32.
A coprocessor with supercomputer capabilities for personal computers
机译:
具有个人计算机的超级计算机功能的协处理器
作者:
Marwood W.
;
Clarke A.P.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
33.
Test generation of C-testable array dividers
机译:
C可测试阵列分隔器的测试生成
作者:
Wey C.-L.
;
Chang S.-M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
34.
Parallel decomposition of multipliers modulo (2/sup n/+or-1)
机译:
乘法器的并行分解模数(2 / sup n / +或-1)
作者:
Skavantzos A.
;
Taylor F.J.
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
关键词:
multiplier decomposition;
multiplying circuits;
digital arithmetic;
multiplication-intensive environments;
polynomial residue-number system;
parallel arithmetic system;
large-word length multipliers;
hardware implementations;
parallel decomposition;
35.
Alternative strategies for applying min-cut to VLSI placement
机译:
应用Min-Cut到VLSI放置的替代策略
作者:
Hill D.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
36.
Variable reduction in MOS timing models
机译:
可变减少MOS时序模型
作者:
Zukowski C.
;
Chen D.-P.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
37.
The Cydra 5 computer system architecture
机译:
CYDRA 5计算机系统架构
作者:
Schlansker M.
;
McNamara M.
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
关键词:
Cydra 5 computer system architecture;
parallel architectures;
recurrences;
directed dataflow architecture;
multiple interactive processors;
numeric processor;
overview;
38.
McMAP: a fast technology mapping procedure for multi-level logic synthesis
机译:
MCMAP:多级逻辑合成的快速技术映射程序
作者:
Lisanke R.
;
Brglez F.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
39.
UBIST version of the SYCO's control section compiler
机译:
Syco控制部分编译器的Ubist版本
作者:
Torki K.
;
Nicolaidis M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
40.
Parallel decomposition of multipliers modulo (2/sup n/+or-1)
机译:
乘法器的并行分解模数(2 / sup n / +或-1)
作者:
Skavantzos A.
;
Taylor F.J.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
41.
Mapping properties of multi-level logic synthesis operations
机译:
多级逻辑合成操作的映射属性
作者:
Lega M.C.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
42.
Transient fault behavior in a microprocessor-A case study
机译:
微处理器中的瞬态故障行为 - 以案例研究
作者:
Duba P.
;
Lyer R.K.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
43.
APES: an integrated system for behavioral design, simulation and evaluation of array processors
机译:
APE:阵列处理器的行为设计,仿真和评估的集成系统
作者:
Distante F.
;
Pieuri V.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
44.
Super computer technology at Convex
机译:
凸的超级计算机技术
作者:
Dozier H.
;
Gruger J.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
45.
Modeling and simulation of coupled lossy lines for VLSI interconnections
机译:
VLSI互连耦合有损线的建模与仿真
作者:
Palusinski O.A.
;
Cangellaris A.C.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
46.
The Cydra 5 computer system architecture
机译:
CYDRA 5计算机系统架构
作者:
Schlansker M.
;
McNamara M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
47.
SID: synthesis of integral design
机译:
SID:整体设计的合成
作者:
Hooper D.F. Jr.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
48.
A rule based logic reorganization system LORES/EX
机译:
基于规则的逻辑重组系统LORORE / EX
作者:
Ishikawa J.
;
Sato H.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
49.
CREATE-LIFE: a design system for high performances VLSI circuits
机译:
创建寿命:高性能VLSI电路的设计系统
作者:
Labrousse J.
;
Slavenburg G.A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
50.
Estimation of area and performance overheads for testable VLSI circuits
机译:
可测试VLSI电路的区域和性能开销估计
作者:
Miles J.R.
;
Ambler A.P.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
51.
Estimation of area and performance overheads for testable VLSI circuits
机译:
可测试VLSI电路的区域和性能开销估计
作者:
Miles J.R.
;
Ambler A.P.
;
Totton K.A.E.
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
关键词:
area estimation;
circui;
automatic testing;
chip performance;
signal propagation delay;
global routing;
stochastic model;
built-in self-test;
static RAMs;
layouts;
programmable logic arrays;
testability;
testable VLSI circuits;
performance overheads;
52.
On fault tolerant structure, distributed fault-diagnosis, reconfiguration, and recovery of the array processors
机译:
关于容错结构,分布式故障诊断,重新配置和阵列处理器的恢复
作者:
Hosseini S.H.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
53.
Automatic layout and optimization of static CMOS cells
机译:
静态CMOS细胞的自动布局和优化
作者:
Mailhot F.
;
DeMicheli G.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
54.
Use of redundant binary representation for fault-tolerant arithmetic array processors
机译:
使用冗余二进制表示对容错算术阵列处理器
作者:
Piuri V.
;
Stefanelli R.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
55.
VITAL: fully automatic placement strategies for very large semicustom designs
机译:
至关重要:非常大的半导体设计的全自动展示策略
作者:
Putatunda R.
;
Smith D.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
56.
The design of a reduced ambient temperature, air cooled supercomputer
机译:
环境温度降低的设计,空气冷却超级计算机
作者:
Mullen D.R.
;
Fernald G.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
57.
Set-associative dynamic random access memory
机译:
SET-关联动态随机存取存储器
作者:
Ward S.A.
;
Zak R.C.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
58.
Instruction reorganization for a variable-length pipelined microprocessor
机译:
用于可变长度流水线微处理器的指令重组
作者:
Abraham S.
;
Padmanabhan K.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
59.
Representation of control and timing behavior with applications to interface synthesis
机译:
用应用程序界面合成的控制和定时行为表示
作者:
Hayati S.A.
;
Parker A.C.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
60.
Classical fault analysis for MOS VLSI circuits
机译:
MOS VLSI电路的经典故障分析
作者:
Shing B.L.
;
Franklin M.A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
61.
Fault tolerance and testing aspects of an architecture for a generalized sidelobe cancellor
机译:
概括的Sidelobe消除器架构的容错和测试方面
作者:
Breuer M.A.
;
Majumdar A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
|
1988年
62.
Multi-chip packaging for high performance systems
机译:
高性能系统的多芯片包装
作者:
Chao C.C.
;
Chen K.H.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
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1988年
63.
Compilations of communicating processes into delay-insensitive circuits
机译:
将过程传送到延迟不敏感电路的汇编
作者:
van Berkel C.H.
;
Saeijs R.W.J.J.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
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1988年
64.
The POTATO chip architecture: a study in tradeoffs for signal processing chip design
机译:
马铃薯芯片架构:信号处理芯片设计的权衡研究
作者:
Sharma B.
;
Jain R.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
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1988年
65.
A methodology for the control and custom VLSI implementation of large-scale Clos networks
机译:
一种控制和自定义VLSI的方法的大规模CLOW网络的实现
作者:
Heath J.R.
;
Disch E.A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
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1988年
66.
Area evaluation metrics for transistor placement
机译:
用于晶体管放置的区域评估度量
作者:
Shiple T.
;
Kollaritsch P.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
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1988年
67.
Potential applications of high-T/sub c/ superconducting transmission lines in integrated systems
机译:
集成系统中高T / SUB C /超导传输线的潜在应用
作者:
Hatamian M.
;
Hornak L.A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
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1988年
68.
VLSI support for copyback caching protocols on Futurebus
机译:
VLSI支持WudioBus上的倒本缓存协议
作者:
Sweazey P.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
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1988年
69.
Design of a 64-processor by 128-memory crossbar switching network
机译:
128存储器横杆交换网络设计64处理器
作者:
Miracky R.F.
;
Hartmann A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
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1988年
70.
Verifiable and executable theories of design for synthesizing correct hardware
机译:
合成正确硬件的可验证和可执行理论的设计
作者:
Chin S.-K.
;
Greene K.J.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Conference on Computer Design》
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1988年
71.
The POTATO chip architecture: a study in tradeoffs for signal processing chip design
机译:
马铃薯芯片架构:信号处理芯片设计的权衡研究
作者:
Sharma B.
;
Jain R.
;
Breuer M.A.
;
Parker A.C.
;
Raghavendra C.
;
Tseng C.Y.
会议名称:
《IEEE International Conference on Computer Design》
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1988年
关键词:
POTATO chip architecture;
digital ar;
computer architecture;
performance estimates;
power of two arithmetic time-optimized;
power-of-two number representation;
high-performance multiplication;
fault-tolerance tradeoffs;
signal processing chip design;
72.
A modular scan-based testability system
机译:
基于模块化扫描的可测试系统
作者:
Brglez F.
;
Bryan D.
;
Calhoun J.
;
Lisanke R.
会议名称:
《IEEE International Conference on Computer Design》
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1988年
关键词:
modular scan-based testability system;
random test pattern gen;
automated test point insertion;
test-pattern compactor;
algorithmic test-pattern generator;
fault simulator;
fault coverage;
scan-based rules;
scan-based audit;
cell-based design system;
73.
The KARL/KARATE system-integrating functional test development into a CAD environment for VLSI
机译:
Karl /空手道系统 - 将功能测试开发集成到CAD环境中为VLSI
作者:
Alfs G.
;
Hartenstein R.W.
;
Wodtko A.
会议名称:
《IEEE International Conference on Computer Design》
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1988年
关键词:
RT level;
VLSI;
integrated circuit testing;
circuit CAD;
interactive user interface;
switch level;
automatic test pattern generation;
testability analysis;
VLSI;
CAD environment;
functional test development;
KARL/KARATE system;
gate level;
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