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狙い通りの機能を実現するために：ロジック回路設計の手ほどき－第6回 最終確認のシミュレーションを行う

机译：实现旨在的功能：逻辑电路设计手 - 执行第6次最终确认的模拟

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今回は論理合成を行い，実際のCPLD/FPGAの特性を含めたシミュレーションを行ってみましょう．シミュレーションの最終段階です．Quartos IIを使って，2006年4月号付録CPLD基板に搭載されたCPLDに回路を作り込むつもりで論理合成を行います．論理合成後のデータを使ったシミュレーション結果は，実際にCPLDにハードウェアを書き込hで動作させたときにより近くなります．このシミュレーションもVeritak-CQ版（トランジスタ技術2006年8月号付録CD-ROMに収録）で行います．連載第1回（2006年6月号）で，シミュレーションには論理合成前と論理合成後の二つがあると紹介しました．二つのシミュレーションの違いも解説します．
机译：这次，让我们制作一个逻辑的合成并模拟实际的CPLD / FPGA特性。 这是模拟的最后阶段。 使用Quartos II，2006年4月附录CPLD CPLD将形成一个安装在电路板上的CPLD的电路。 当硬件实际写入CPLD时，逻辑合成后使用数据的仿真结果更接近H写H. 此模拟也在Veritak-CQ版本（2006年8月2006年8月）中进行。 在第一个系列（2006年6月）中，引入了模拟逻辑合成后有两个和逻辑合成。 我还解释了两种模拟之间的差异。

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