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ダイレクト·サンプリングFM SDRの製作 第15回 フルディジタルPLLのFPGA実装②I／O入力位相比較器とフルディジタルVCO

机译：通过比较器和全数字VCO生产直接采样FM SDR 15th全数字PLL FPGA实现2I / O输入

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本連載では，高速A-DコンバータとFPGAを搭載したダイレクト·サンプリングFMレシーバ（型名FMDDC-3，写真1）とその評価環境を作りながら，高性能なフルディジタル受信機SDR（Software Defined Radio）を実現するハードウェア信号処理回路とはどのようなものなのかを考察，研究しています．前回と今回，そして次回のテーマは，フルディジタルPLLです．PLL回路は，周波数を合成するためのもの，という理解が一般的ですが，ループへの入力場所と出力場所を選ぶことで，FM検波（復調）など，別の用途にも使うことができます．例えば，連載第11回（2019年10 月号）で紹介したCORDICを使ったFM復調回路は，回路規模が大きいのが難点ですが，前回紹介したミニマル構成のフルディジタルPLL回路（図1）に置き換えることができれば，FPGAのリソースを節約できます．今回は，I信号とQ信号の入力チャネルを2個（計4入力）備える汎用性の高い高性能な位相検出回路とフルディジタルVCO（NCO，Numerically Controlled Oscillator）の作り方を紹介します．従来からある実数入力タイプの位相検出回路は，スプリアス（高調波など不要な成分）がたくさh発生しひずみが小さくありませh．
机译：在本系列中，在进行环境环境的同时，实现了配备FPGA（类型FMDDC-3，照片1）及其评估环境的高速AD转换器和直接采样FM接收器。我们正在学习和研究什么样的硬件信号处理电路。最后一个和这个时间，下一个主题是一个完整的数字pll。 PLL电路是常见的合成频率，而是通过选择输入位置和输出位置来循环，也可以用于不同的应用，例如FM检测（解调）。例如，使用Cordic在第11系列（2019年10月）中推出的FM解调电路是一个主要的电路刻度，但是最小的配置的全数字PLL电路（图1）最后一次推出的最小配置如果您可以替换，则可以保存FPGA资源。这次，我们介绍了如何制作高性能高性能相位检测电路和全数字VCO（NCO，NUCO，NUCO，数控振荡器），其配备了I和Q信号的两个输入通道（总计4个输入） 。传统的真实输入类型检测电路具有杂散（诸如谐波的不必要的部件），并且应变不小并且应变不低。

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