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UVM-based verification methodology for RFID-enabled smart-sensor systems

机译：基于UVM的RFID智能传感器系统验证方法

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Universal verification methodology (UVM) is a standardized methodology for verifying integrated circuit designs. In this contribution, we present a UVM-based verification methodology for verifying mixed-signal smart-sensor systems. Our approach permits the validation of system functionality before implementation and also to verify the implementation on various levels of abstraction. The model-based verification approach enables to build a scalable and reusable framework, in which assertions and constrained-random stimuli are used to monitor and also to verify mixed-signal-system behavior automatically. A comprehensive example of an radio-frequency identification-based smart-sensor mixed-signal system used for bioanalytical applications is presented. Along with the designed UVM test bench architecture, we describe a novel solution for estimating the power consumption of the digital sub-system using application-specific random-activity patterns generated during UVM test bench runs (Neumann et al., Synthesis Modelling Analysis and Simulation Methods and Application to Circuit Design, SMACD, 2012).
机译：通用验证方法（UVM）是用于验证集成电路设计的标准化方法。在此贡献中，我们提出了一种基于UVM的验证方法，用于验证混合信号智能传感器系统。我们的方法允许在实现之前验证系统功能，并且还可以在各种抽象级别上验证实现。基于模型的验证方法能够构建可伸缩且可重用的框架，其中使用断言和约束随机刺激来监视和自动验证混合信号系统的行为。给出了用于生物分析应用的基于射频识别的智能传感器混合信号系统的综合示例。连同设计的UVM测试台架构一起，我们描述了一种使用UVM测试台运行期间生成的特定于应用的随机活动模式来估算数字子系统功耗的新颖解决方案（Neumann等人，综合建模分析与仿真《方法与电路设计应用》，SMACD，2012年）。

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