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机译:FPGA实现的高效进位选择加法器设计
U Sajesh Kumar; K Mohamed Salih K;
机译:利用FPGA的省时携带选择加法器的设计与实现
机译:改进的SQRT进位选择加法器在FPGA上的设计与实现
机译:使用快速加法器设计面积和速度有效的平方根进位选择加法器
机译:FPGA上功率和速度高效的进位选择加法器的设计与实现
机译:使用推测性Han-Carlson并行前缀加法器实现的高速进位跳过加法器。
机译:量子点元胞自动机中高效全加器的设计
机译:FpGa中混合高速区域高效并行前缀加法器的设计与实现
机译:定期,区域有效的Carry-Lookahead加法器
机译:用于基于标准电池的设计的功率和面积优化的载波选择添加器以及包括该选择器的方法
机译:自检全称和自检携带选择加成
机译:自检完整加法器和具有完整加法器的自检进位选择加法器
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