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卷积核参数可配的神经卷积阵列电路核、处理器及电路

摘要

本公开提供了卷积核参数可配的神经卷积阵列电路核、处理器及电路。卷积核参数可配的神经卷积阵列电路核,包括数据滑动移入部分,被配置为将卷积阵列划分成多个并行数据窗口;多路选择器,被配置为:通过像素数据输入总线扫描右移输入像素数据,完成对卷积阵列的像素数据的右移滑动更新;通过卷积核系数输入总线串行扫描卷积核系数,完成对卷积阵列的卷积核的系数配置;通过选择端使能多路选择器的两个输入端口中的一个输入端选择性更新数据;点乘部分,被配置为:将每个并行数据窗口内的像素数据与相应卷积核对应各个点系数进行点乘并将点乘结果累加,得到每个并行数据窗口与其对应卷积核的一个卷积结果。

著录项

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2019-08-20

    实质审查的生效 IPC(主分类):G06N3/063 申请日:20190428

    实质审查的生效

  • 2019-07-26

    公开

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