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具有两个存储器位置的向量压缩2指令和扩展2指令

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所公开的实施例涉及具有两个存储器位置的向量compress2指令和expand2指令。在一个示例中，一种系统包括存储器和处理器，该处理器包括用于取出、解码、和执行指令的电路，该指令包括操作码、第一目的地操作数标识符、第二目的地操作数标识符、源操作数标识符、和控制掩码，其中，对于源操作数的每个元素，执行电路用于：通过执行元素的压缩和扩展中的一者来生成结果；以及基于控制掩码的对应于该元素的位的值，将结果存储到由第一目的地操作数标识符标识的第一位置，并且将第一目的地操作数标识符递增该结果的尺寸，否则，将结果存储到由第二目的地操作数标识符标识的第二位置，并将第二目的地操作数标识符递增该结果的尺寸。

著录项

公开/公告号CN110383243A

专利类型发明专利
公开/公告日2019-10-25

原文格式PDF
申请/专利权人英特尔公司;
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申请/专利号CN201780087847.X
发明设计人 M·普洛特基诺夫;I·厄莫拉夫;A·博比尔;
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申请日2017-04-06
分类号
代理机构上海专利商标事务所有限公司;
代理人黄嵩泉
地址美国加利福尼亚州
入库时间 2024-02-19 15:53:20

法律信息

法律状态公告日

法律状态信息

法律状态
2020-05-05

实质审查的生效 IPC(主分类):G06F9/30 申请日:20170406

实质审查的生效
2019-10-25

公开

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1. 具有两个存储器位置的向量压缩2指令和扩展2指令 [P] . 中国专利： CN110383243A . 2019-10-25
2. 在具有至少两个处理单元和用于数据和/或指令的至少一个第一存储器或存储器区域的计算机系统中存储数据和/或指令的设备和方法 [P] . 中国专利： CN101243416A . 2008-08-13
3. Processor and method for generating and storing compressed instructions in a program memory and decompressed instructions in an instruction cache wherein the decompressed instructions are assigned imaginary addresses derived from information stored in the program memory with the compressed instructions [P] . 美国专利： US2005125633A1 . 2005-06-09

机译：用于在程序存储器中生成和存储压缩指令并在指令高速缓存中生成和存储解压缩指令的处理器和方法，其中为解压缩的指令分配了虚地址，该虚地址由从具有压缩指令的程序存储器中存储的信息得出
4. Processor and method for generating and storing compressed instructions in a program memory and decompressed instructions in an instruction cache wherein the decompressed instructions are assigned imaginary addresses derived from information stored in the program memory with the compressed instructions [P] . 美国专利： US7343471B2 . 2008-03-11

机译：用于在程序存储器中生成和存储压缩指令并在指令高速缓存中生成和存储解压缩指令的处理器和方法，其中为解压缩的指令分配了虚地址，该虚地址从与压缩指令一起存储在程序存储器中的信息中导出
5. Processor and method for generating and storing compressed instructions in a program memory and decompressed instructions in an instruction cache wherein the decompressed instructions are assigned imaginary addresses derived from information stored in the program memory with the compressed instructions [P] . 美国专利： US7124279B2 . 2006-10-17

机译：用于在程序存储器中生成和存储压缩指令并在指令高速缓存中生成和存储解压缩指令的处理器和方法，其中为解压缩的指令分配了虚地址，该虚地址从与压缩指令一起存储在程序存储器中的信息中导出