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在RS译码器中用于计算伴随多项式的装置

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本发明公开了一种在RS译码器中用于伴随式计算的装置，该装置具有更小的伴随式计算延迟和更高的译码速率，同时该装置还不需要前置的解交织器。为了实现上述目的，公开了一种通过伴随式计算公式变换使得伴随式计算装置支持多路并行输入的方法。本发明所述的伴随式计算装置包括一个多路并行的数据输入接口以及2t个基本单元。每个基本单元包括若干个与多路并行输入相连接的伽罗华域常数乘法器，一个伽罗华域加法器，一个与寄存器相连的伽罗华域常数乘法器，若干个寄存器，以及若干个复用器和解复用器。

著录项

公开/公告号CN103929208A

专利类型发明专利
公开/公告日2014-07-16

原文格式PDF
申请/专利权人北京大学;
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申请/专利号CN201410119903.1
发明设计人郭文;盖伟新;
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申请日2014-03-27
分类号H03M13/15;H04L1/00;
代理机构
代理人
地址 100871 北京市海淀区颐和园路5号
入库时间 2023-12-17 00:35:36

法律信息

法律状态公告日

法律状态信息

法律状态
2019-11-12

发明专利申请公布后的视为撤回 IPC(主分类):H03M13/15 申请公布日:20140716 申请日:20140327

发明专利申请公布后的视为撤回
2017-02-22

实质审查的生效 IPC(主分类):H03M13/15 申请日:20140327

实质审查的生效
2014-07-16

公开

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