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一种基于FPGA的PCIe接口设计方法

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本发明涉及一种基于FPGA的PCIe接口设计方法，建立FPGA工程并导入PCIe IP核将其实例化，对相应的需求进行配置，同时加入PIO设计的源文件；PIO模块内部主要包括RX接收模块、TX发送模块、存储器连接模块、存储器模块；EP端TX模块实现的是事务层TLP包的发送，是向Endpoint的PCIe IP核回传数据的发送模块，数据会最终发送至RC；在EP接收到Non‑Posted TLP，TX通过发送CplD或Cpl来响应操作，TX模块实现的是组包的过程；EP端RX模块实现的是事务层TLP包的接收，是用于接收和分析从外部发送来的读写TLP包的模块；PIO设计中的Mem Access模块实现数据的软硬件交互存储与读取；将PIO模块与PCIe的IP核模块相连接，PCIe的IP核模块负责将传输的事务层报文数据进行以PCIe协议为结构的拆包或组包。

著录项

公开/公告号CN110851376A

专利类型发明专利
公开/公告日2020-02-28

原文格式PDF
申请/专利权人天津大学;
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申请/专利号CN201910997757.5
发明设计人张为;邹述铭;
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申请日2019-10-21
分类号
代理机构天津市北洋有限责任专利代理事务所;
代理人程毓英
地址 300072 天津市南开区卫津路92号
入库时间 2023-12-17 06:51:40

法律信息

法律状态公告日

法律状态信息

法律状态
2020-03-24

实质审查的生效 IPC(主分类):G06F13/10 申请日:20191021

实质审查的生效
2020-02-28

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