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一种基于FPGA的抗DPA攻击的AES加密方法

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本发明公开了基于FPGA的抗DPA攻击AES加密方法，利用在初始加密时将明文异或上随机掩码，削弱原本加密过程中密钥和和FPGA动态功耗的强相关性，有效抵抗针对AES加密的DPA攻击。利用重新设计的sTable_mask和掩码解除操作，使输出的加密数据符合标准AES加密规则。将多个sTable_mask存放在一个ROM中，简化了查表操作逻辑。在系统架构上，采用全流水线设计，利用多个ROM查表方式简化级间逻辑复杂度，从而大大提高系统最大工作频率，进而提升系统吞吐量。

著录项

公开/公告号CN111385290A

专利类型发明专利
公开/公告日2020-07-07

原文格式PDF
申请/专利权人杭州电子科技大学;
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申请/专利号CN202010136860.3
发明设计人黄继业;刘鹏;高明裕;金昊炫;吕群芳;杨宇翔;何志伟;董哲康;
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申请日2020-03-02
分类号
代理机构浙江永鼎律师事务所;
代理人陆永强
地址 310018 浙江省杭州市下沙高教园区2号大街1号
入库时间 2023-12-17 10:08:05

法律信息

法律状态公告日

法律状态信息

法律状态
2020-07-31

实质审查的生效 IPC(主分类):H04L29/06 申请日:20200302

实质审查的生效
2020-07-07

公开

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