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一种多功能数字化时钟电路

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一种多功能数字化时钟电路涉及一种数字化时钟恢复方法及其电路，属于数字通信技术领域。本发明提出一种数字化时钟恢复方法及其电路，尽量避免模拟处理和模拟电路，以减少噪声对时钟恢复的影响的一种多功能数字化时钟电路。提出以数字化时钟恢复方法，包括如下方法：将数字通信中的输入信号与恢复时钟进行比较，得到相位误差信号；利用数字信号处理对上述相位误差信号进行滤波，以滤除相位误差信号中的干扰和噪声，得到平滑后的相位误差值。

著录项

公开/公告号CN101707520A

专利类型发明专利
公开/公告日2010-05-12

原文格式PDF
申请/专利权人王宏涛;
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申请/专利号CN200810118949.6
发明设计人王宏涛;
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申请日2008-08-27
分类号H04L7/00;H04L7/027;
代理机构
代理人
地址 110179 辽宁省沈阳市浑南新区金卡路25号
入库时间 2023-12-17 23:57:08

法律信息

法律状态公告日

法律状态信息

法律状态
2012-05-23

发明专利申请公布后的视为撤回 IPC(主分类):H04L7/00 公开日:20100512 申请日:20080827

发明专利申请公布后的视为撤回
2010-05-12

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1. 一种多功能数字化时钟电路 [P] . 中国专利： CN101707520A . 2010-05-12
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4. A synchronous semiconductor memory device having an internal clock signal generation circuit for generating an internal clock signal which is phase-locked with high precision with respect to an external clock signal. [P] . 韩国专利： KR19990036526A . 1999-05-25

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