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用于双存储器原子操作的硬件支持

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公开的实施例涉及对于双存储器原子操作的硬件支持。在一个示例中，处理器包括多个核，每个核包括：多个多线程流水线(MTP)，每个MTP与存储器相关联；原子单元(ATMU)，用于执行原子操作；以及写组合缓冲器(WCB)，用于管理对关联的存储器中的高速缓存行的访问和锁定，每个MTP包括提取和解码级以提取和解码指令，所述指令具有用来指定第一和第二存储器位置以及操作码(其调用第一MTP来向所述多个MTP中的第二MTP发送请求)的字段，所述第二MTP与所述第一存储器位置所映射到的存储器相关联且用来使用其关联的ATMU和WCB在所述第一和第二存储器位置上执行原子双存储器操作以执行所述请求。

著录项

公开/公告号CN112130970A

专利类型发明专利
公开/公告日2020-12-25

原文格式PDF
申请/专利权人英特尔公司;
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申请/专利号CN202010223756.8
发明设计人 R.鲍洛夫斯基;J.B.弗里曼;V.卡夫;E.M.施瓦茨;I.B.加内夫;J.M.郝华德;A.摩尔;S.史密斯;
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申请日2020-03-26
分类号G06F9/48(20060101);
代理机构72001 中国专利代理(香港)有限公司;
代理人李伟森;姜冰
地址美国加利福尼亚州
入库时间 2023-06-19 09:18:22

法律信息

法律状态公告日

法律状态信息

法律状态
2022-07-15

实质审查的生效 IPC(主分类):G06F 9/48 专利申请号:2020102237568 申请日:20200326

实质审查的生效

相似文献

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外文文献

1. 用于双存储器原子操作的硬件支持 [P] . 中国专利： CN112130970A . 2020-12-25
2. 用于支持任务间通信的基于硬件的原子操作 [P] . 中国专利： CN106104488A . 2016-11-09
3. Hardware-based atomic operations for supporting inter-task communication [P] . 美国专利： US10055342B2 . 2018-08-21

机译：基于硬件的原子操作，用于支持任务间通信
4. Support apparatus and method for processing data and using hardware support for atomic memory transactions [P] . 美国专利： US10241933B2 . 2019-03-26

机译：用于处理数据并将硬件支持用于原子存储器事务的支持装置和方法
5. Hardware mechanism designing method for improving calling procedure of operating system, involves applying hardware mechanism to current processors supporting dual mode of execution of instructions [P] . ES2301309A1 . 2008-06-16

机译：一种改善操作系统调用过程的硬件机制设计方法，涉及将硬件机制应用于当前支持指令双执行模式的处理器