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一种基于FPGA的减少BUFG资源的实时传输实现系统及方法

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本发明提供了一种基于FPGA的减少BUFG资源的实时传输实现系统，包括主控模块和辅助模块，所述主控模块与辅助模块相连接；所述主控模块包括高速采集板、信号处理板和时序控制板，所述高速采集板与信号处理板相连接，所述信号处理板与时序控制板相连接；所述辅助模块包括电源模块、板卡和机箱背板；所述机箱背板上设置有数据外部接口、同步时钟接口和射频时钟接口，所述辅助模块上设置有检测板，所述检测板包括第一汇总芯片、第二汇总芯片、第三汇总芯片和第四汇总芯片，所述第四汇总芯片产生BUFG超标问题。本发明为后续高速宽带多路数据处理得以顺利进行奠定了基础，具有很实用的工程价值。

著录项

公开/公告号CN112948309A

专利类型发明专利
公开/公告日2021-06-11

原文格式PDF
申请/专利权人上海微波设备研究所(中国电子科技集团公司第五十一研究所);
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申请/专利号CN202110264459.2
发明设计人贾云飞;石林艳;周鹤;
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申请日2021-03-11
分类号G06F13/42(20060101);G06F13/40(20060101);
代理机构31334 上海段和段律师事务所;
代理人李佳俊;郭国中
地址 201802 上海市嘉定区南翔镇沪宜公路185号
入库时间 2023-06-19 11:22:42

法律信息

法律状态公告日

法律状态信息

法律状态
2023-05-16

授权

发明专利权授予

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