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一种基于Banyan网络和多FPGA结构的EDA硬件加速方法与系统

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摘要

本发明给出了一种基于Banyan网络和多FPGA结构的EDA硬件加速方法与系统，包括将EDA算法加速和仿真加速结合在一个系统内，EDA算法加速时启用顶层EDA算法控制数据的发送和接收，EDA仿真加速时根据用户所设计的待测设计结构以及用户输入的仿真数据；同时采用多通道SCE‑MI接口进行软硬件数据协同，再使用Banyan网络来实现多FPGA的数据交换；最后将加速后的数据回传进行处理，将仿真数据与验证数据进行对比验证仿真结果，或将运算结果数据返回给外部EDA软件。本方法采用软硬件协同方式对算法和仿真进行加速，将EDA算法加速和仿真加速结合，采用多通道PIPE式SCE‑MI标准协议接口，具有普适性，同时将Banyan网络应用于多FPGA数据交换，降低了数据交换延迟，使得系统实现结构简单、功能高效。

著录项

公开/公告号CN114090250A

专利类型发明专利
公开/公告日2022-02-25

原文格式PDF
申请/专利权人厦门大学;
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申请/专利号CN202111389032.1
发明设计人郭东辉;沈云飞;马钦鸿;贺珊;
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申请日2021-11-22
分类号G06F9/50(20060101);G06F9/48(20060101);
代理机构35235 厦门福贝知识产权代理事务所(普通合伙);
代理人陈远洋
地址 361000 福建省厦门市思明区思明南路422号
入库时间 2023-06-19 14:17:30

法律信息

法律状态公告日

法律状态信息

法律状态
2022-03-15

实质审查的生效 IPC(主分类):G06F 9/50 专利申请号:2021113890321 申请日:20211122

实质审查的生效

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